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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- Korean Institute of Information Scientists and Engineers Journal of Electrical Engineering and Information Science Journal of Electrical Engineering and Information Science Vol.3 No.6
- 발행연도
- 1998.12
- 수록면
- 736 - 741 (6page)
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This paper discusses how we generate VHDL codes for DSP applications described in dataflow graphs. Because the generated VHDL code implements the details of the control structure, we can easily transform it into a running circuit without any modifications, using logic synthesis tools. To improve the quality of the synthesized circuit we apply some graph transformation techniques to the original dataflow graph. We mainly consider coarse-grained dataflow graphs in which each node corresponds to an IP component of considerable size. The proposed facility is very useful for dataflow graph based high level design tools, including our codesign framework PeaCE (Ptolemy extension as Codesign Environment).
목차
Abstract
Ⅰ. Introduction
Ⅱ. Correctness of Operation
Ⅲ. Performance of the Synthesized Circuit
Ⅳ. VHDL Code Generation
Ⅴ. Examples
Ⅵ. Conclusions
Acknowledgement
References
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