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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.17 No.1
- 발행연도
- 2017.2
- 수록면
- 101 - 109 (9page)
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This paper presents a high-throughput lowcomplexity 512-point eight-parallel mixed-radix multipath delay feedback (MDF) fast Fourier transform (FFT) processor architecture for orthogonal frequency division multiplexing (OFDM) applications. To decrease the number of twiddle factor (TF) multiplications, a mixed-radix 2<SUP>4</SUP>/2<SUP>3</SUP> FFT algorithm is adopted. Moreover, a dual-path shared canonical signed digit (CSD) complex constant multiplier using a multi-layer scheme is proposed for reducing the hardware complexity of the TF multiplication. The proposed FFT processor is implemented using TSMC 90-nm CMOS technology. The synthesis results demonstrate that the proposed FFT processor can lead to a 16% reduction in hardware complexity and higher throughput compared to conventional architectures.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. MIXED-RADIX 2⁴/2³ FFT ALGORITHM
Ⅲ. PROPOSED FFT ARCHITECTURE
Ⅳ. IMPLEMENTATION RESULTS AND PERFORMANCE COMPARISON
Ⅴ. CONCLUSIONS
REFERENCES
참고문헌 (14)
참고문헌 신청
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