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저자정보
김재욱 (서울대학교) 김수환 (서울대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2020년도 대한전자공학회 하계종합학술대회 논문집
발행연도
2020.8
수록면
241 - 244 (4page)

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In applications that operate at double data rates, such as memory systems, it is important to compensate for duty distortion. Therefore, DCC a circuit for adjusting the duty to the clock signal, has been recently introduced in memory. We design a digital DCC for high speed systems that operates up to 4㎓ 65㎚ CMOS process. At a supply voltage of 1V, it provides a 10~90% input duty tuning range at 2.4~4㎓. This digital DCC shows power consumption of 0.71㎽ at 2.4㎓ and 0.76㎽ at 4㎓.

목차

Abstract
Ⅰ. 서론
Ⅱ. 회로 구성 및 분석
Ⅲ. 결과
Ⅳ. 결론
참고문헌

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