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논문 기본 정보

자료유형
학술저널
저자정보
이동규 (경북대학교) 박대진 (경북대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제25권 제1호
발행연도
2021.1
수록면
20 - 26 (7page)

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오늘날의 시스템들은 더 빠른 실행 속도와 더 적은 전력 소모를 위해 하드웨어와 소프트웨어 요소를 함께 포함하고 있다. 기존 하드웨어 및 소프트웨어 공동 설계에서 소프트웨어와 하드웨어의 비율은 설계자의 경험적 지식에 의해 나뉘었다. 설계자들은 반복적으로 가속기와 응용 프로그램을 재구성하고 시뮬레이션하며 최적의 결과를 찾는다. 설계를 변경하며 반복적으로 시뮬레이션하는 것은 시간이 많이 소모되는 일이다. 본 논문에서는 에너지 효율적인 FPGA 가속기 설계를 위한 하드웨어 및 소프트웨어 공동 설계 플랫폼을 제안한다. 제안하는 플랫폼은 가속기를 구성하는 주요 성분을 변수화해 응용 프로그램 코드와 하드웨어 코드를 자동으로 생성하여 설계자가 적절한 하드웨어 비율을 쉽게 찾을 수 있도록 한다. 공동 설계 플랫폼은 Xilinx Alveo U200 FPGA가 탑재된 서버에서 Vitis 플랫폼을 기반으로 동작한다. 공동 설계 플랫폼을 통해 1000개의 행을 가지는 두 행렬의 곱셈 연산 가속기를 최적화한 결과 응용프로그램보다 실행 시간이 90.7%, 전력 소모가 56.3% 감소하였다.
#공동 설계 플랫폼 #FPGA #Alveo U200 #Vitis 통합 소프트웨어 플랫폼 #하드웨어 가속 #Co-design platform #FPGA(Field programmable gate array) #Vitis unified software platform #Hardware acceleration

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 시뮬레이션 환경
Ⅲ. 효율적인 FPGA 가속기 설계 플랫폼
Ⅳ. 결과 분석
Ⅴ. 결론
REFERENCES

참고문헌 (10)

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